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Commit f9dafc74 authored by Cherry Zhang's avatar Cherry Zhang
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cmd/compile, runtime, etc: get rid of constant FP registers 

On ARM64, MIPS64, and PPC64, some floating point registers were
reserved for constants 0, 1, 2, 0.5, etc. This CL removes them.

On ARM64, they are never used. On MIPS64 and PPC64, the only use
case is a multiplication-by-2 in the old backend of the compiler,
which is replaced with an addition.

Change-Id: I737cbf43283756e3408964fc88c567a938c57036
Reviewed-on: https://go-review.googlesource.com/28095
Run-TryBot: Cherry Zhang <cherryyz@google.com>
Reviewed-by: default avatarDavid Chase <drchase@google.com>
TryBot-Result: Gobot Gobot <gobot@golang.org>
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src/cmd/compile/internal/arm64/gsubr.go
View file @ f9dafc74
......@@ -43,10 +43,6 @@ var resvd = []int{
arm64.REGRT1,
arm64.REGRT2,
arm64.REG_R31, // REGZERO and REGSP
arm64.FREGZERO,
arm64.FREGHALF,
arm64.FREGONE,
arm64.FREGTWO,
}
/*
......
src/cmd/compile/internal/mips64/gsubr.go
View file @ f9dafc74
......@@ -47,10 +47,6 @@ var resvd = []int{
mips.REGTMP,
mips.REG_R26, // kernel
mips.REG_R27, // kernel
mips.FREGZERO,
mips.FREGHALF,
mips.FREGONE,
mips.FREGTWO,
}
/*
......@@ -516,8 +512,7 @@ func gmove(f *gc.Node, t *gc.Node) {
if ft == gc.TUINT64 {
p1 := ginsbranch(mips.ABEQ, nil, &rtmp, nil, 0)
gc.Nodreg(&r1, gc.Types[gc.TFLOAT64], mips.FREGTWO)
gins(mips.AMULD, &r1, &r2)
gins(mips.AADDD, &r2, &r2)
gc.Patch(p1, gc.Pc)
}
......
src/cmd/compile/internal/mips64/reg.go
View file @ f9dafc74
......@@ -112,10 +112,6 @@ func regnames(n *int) []string {
func excludedregs() uint64 {
// Exclude registers with fixed functions
regbits := 1<<0 | RtoB(mips.REGSP) | RtoB(mips.REGG) | RtoB(mips.REGSB) | RtoB(mips.REGTMP) | RtoB(mips.REGLINK) | RtoB(mips.REG_R26) | RtoB(mips.REG_R27)
// Also exclude floating point registers with fixed constants
regbits |= RtoB(mips.FREGZERO) | RtoB(mips.FREGHALF) | RtoB(mips.FREGONE) | RtoB(mips.FREGTWO)
return regbits
}
......
src/cmd/compile/internal/ppc64/gsubr.go
View file @ f9dafc74
......@@ -51,11 +51,6 @@ var resvd = []int{
// TODO(austin): Consolidate REGTLS and REGG?
ppc64.REGG,
ppc64.REGTMP, // REGTMP
ppc64.FREGCVI,
ppc64.FREGZERO,
ppc64.FREGHALF,
ppc64.FREGONE,
ppc64.FREGTWO,
}
/*
......@@ -500,8 +495,7 @@ func gmove(f *gc.Node, t *gc.Node) {
gc.Regfree(&r1)
if ft == gc.TUINT64 {
p1 := gc.Gbranch(optoas(gc.OLT, gc.Types[gc.TUINT64]), nil, +1) // use CR0 here again
gc.Nodreg(&r1, gc.Types[gc.TFLOAT64], ppc64.FREGTWO)
gins(ppc64.AFMUL, &r1, &r2)
gins(ppc64.AFADD, &r2, &r2)
gc.Patch(p1, gc.Pc)
}
gmove(&r2, t)
......
src/cmd/compile/internal/ppc64/reg.go
View file @ f9dafc74
......@@ -119,9 +119,6 @@ func excludedregs() uint64 {
regbits |= RtoB(ppc64.REG_R2)
regbits |= RtoB(ppc64.REG_R12)
}
// Also exclude floating point registers with fixed constants
regbits |= RtoB(ppc64.REG_F27) | RtoB(ppc64.REG_F28) | RtoB(ppc64.REG_F29) | RtoB(ppc64.REG_F30) | RtoB(ppc64.REG_F31)
return regbits
}
......
src/cmd/compile/internal/ssa/gen/ARM64Ops.go
View file @ f9dafc74
......@@ -91,10 +91,10 @@ var regNamesARM64 = []string{
"F25",
"F26",
"F27",
"F28", // 0.0
"F29", // 0.5
"F30", // 1.0
"F31", // 2.0
"F28",
"F29",
"F30",
"F31",
// pseudo-registers
"SB",
......@@ -128,7 +128,7 @@ func init() {
gpsp = gp | buildReg("SP")
gpspg = gpg | buildReg("SP")
gpspsbg = gpspg | buildReg("SB")
fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27")
fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31")
callerSave = gp | fp | buildReg("g") // runtime.setg (and anything calling it) may clobber g
)
// Common regInfo
......
src/cmd/compile/internal/ssa/gen/MIPS64Ops.go
View file @ f9dafc74
......@@ -88,13 +88,13 @@ var regNamesMIPS64 = []string{
"F21",
"F22",
"F23",
"F24", // 0.0
"F24",
"F25",
"F26", // 0.5
"F26",
"F27",
"F28", // 1.0
"F28",
"F29",
"F30", // 2.0
"F30",
"F31",
"HI", // high bits of multiplication
......@@ -132,7 +132,7 @@ func init() {
gpsp = gp | buildReg("SP")
gpspg = gpg | buildReg("SP")
gpspsbg = gpspg | buildReg("SB")
fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31")
fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31")
lo = buildReg("LO")
hi = buildReg("HI")
callerSave = gp | fp | lo | hi | buildReg("g") // runtime.setg (and anything calling it) may clobber g
......
src/cmd/compile/internal/ssa/gen/PPC64Ops.go
View file @ f9dafc74
......@@ -77,11 +77,11 @@ var regNamesPPC64 = []string{
"F24",
"F25",
"F26",
// "F27", // reserved for "floating conversion constant"
// "F28", // 0.0
// "F29", // 0.5
// "F30", // 1.0
// "F31", // 2.0
"F27",
"F28",
"F29",
"F30",
"F31",
// "CR0",
// "CR1",
......
src/cmd/compile/internal/ssa/opGen.go
View file @ f9dafc74
......@@ -10295,11 +10295,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFADDS,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10310,11 +10310,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFADDD,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10324,11 +10324,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFSUBS,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10338,11 +10338,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFSUBD,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10353,11 +10353,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFMULS,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10368,11 +10368,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFMULD,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10382,11 +10382,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFDIVS,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10396,11 +10396,11 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFDIVD,
reg: regInfo{
inputs: []inputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
{1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
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{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -10551,10 +10551,10 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFNEGS,
reg: regInfo{
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{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
{0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
outputs: []outputInfo{
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},
},
},
......@@ -10564,10 +10564,10 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFNEGD,
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},
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},
},
},
......@@ -10577,10 +10577,10 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFSQRTD,
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},
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},
},
},
......@@ -10829,8 +10829,8 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFCMPS,
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},
},
},
......@@ -10840,8 +10840,8 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFCMPD,
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},
},
......@@ -11171,7 +11171,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
},
......@@ -11183,7 +11183,7 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFMOVD,
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{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
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},
},
},
......@@ -11310,7 +11310,7 @@ var opcodeTable = [...]opInfo{
{0, 4611686019232432127}, // R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R19 R20 R21 R22 R23 R24 R25 R26 g SP SB
},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
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},
},
},
......@@ -11324,7 +11324,7 @@ var opcodeTable = [...]opInfo{
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},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
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},
},
},
......@@ -11383,8 +11383,8 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFMOVS,
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inputs: []inputInfo{
{1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
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},
},
},
......@@ -11395,8 +11395,8 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFMOVD,
reg: regInfo{
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},
},
},
......@@ -11557,7 +11557,7 @@ var opcodeTable = [...]opInfo{
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},
outputs: []outputInfo{
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},
},
},
......@@ -11570,7 +11570,7 @@ var opcodeTable = [...]opInfo{
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},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
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},
},
},
......@@ -11583,7 +11583,7 @@ var opcodeTable = [...]opInfo{
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},
outputs: []outputInfo{
{0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27
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},
},
},
......@@ -11596,7 +11596,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
},
......@@ -11609,7 +11609,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
},
......@@ -11622,7 +11622,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
},
......@@ -11635,7 +11635,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
......@@ -11648,7 +11648,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
......@@ -11658,7 +11658,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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......@@ -11671,7 +11671,7 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFCVTZSDW,
reg: regInfo{
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},
outputs: []outputInfo{
{0, 133955583}, // R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R19 R20 R21 R22 R23 R24 R25 R26
......@@ -11684,7 +11684,7 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFCVTZUSW,
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......@@ -11697,7 +11697,7 @@ var opcodeTable = [...]opInfo{
asm: arm64.AFCVTZUDW,
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},
},
},
......@@ -11775,10 +11775,10 @@ var opcodeTable = [...]opInfo{
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{
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},
{
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{
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},
{
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},
},
{
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outputs: []outputInfo{
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},
},
},
......@@ -12190,11 +12190,11 @@ var opcodeTable = [...]opInfo{
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},
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......@@ -12204,11 +12204,11 @@ var opcodeTable = [...]opInfo{
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},
},
},
......@@ -12218,11 +12218,11 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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{0, 576460752169205760}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
},
},
},
......@@ -12233,11 +12233,11 @@ var opcodeTable = [...]opInfo{
asm: mips.AMULF,
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{0, 385057768005959680}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31
{1, 385057768005959680}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31
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},
},
},
......@@ -12248,11 +12248,11 @@ var opcodeTable = [...]opInfo{
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},
},
},
......@@ -12262,11 +12262,11 @@ var opcodeTable = [...]opInfo{
asm: mips.ADIVF,
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},
outputs: []outputInfo{
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},
},
},
......@@ -12276,11 +12276,11 @@ var opcodeTable = [...]opInfo{
asm: mips.ADIVD,
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outputs: []outputInfo{
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},
},
},
......@@ -12418,10 +12418,10 @@ var opcodeTable = [...]opInfo{
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{0, 385057768005959680}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31
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},
outputs: []outputInfo{
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},
},
......@@ -12431,10 +12431,10 @@ var opcodeTable = [...]opInfo{
asm: mips.ANEGD,
reg: regInfo{
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outputs: []outputInfo{
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},
},
},
......@@ -12584,8 +12584,8 @@ var opcodeTable = [...]opInfo{
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},
},
},
......@@ -12595,8 +12595,8 @@ var opcodeTable = [...]opInfo{
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},
},
},
......@@ -12606,8 +12606,8 @@ var opcodeTable = [...]opInfo{
asm: mips.ACMPGEF,
reg: regInfo{
inputs: []inputInfo{
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},
},
},
......@@ -12617,8 +12617,8 @@ var opcodeTable = [...]opInfo{
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},
},
},
......@@ -12628,8 +12628,8 @@ var opcodeTable = [...]opInfo{
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},
},
},
......@@ -12639,8 +12639,8 @@ var opcodeTable = [...]opInfo{
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reg: regInfo{
inputs: []inputInfo{
{0, 385057768005959680}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31
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{1, 576460752169205760}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
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},
},
......@@ -12664,7 +12664,7 @@ var opcodeTable = [...]opInfo{
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},
},
......@@ -12676,7 +12676,7 @@ var opcodeTable = [...]opInfo{
asm: mips.AMOVD,
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},
},
},
......@@ -12803,7 +12803,7 @@ var opcodeTable = [...]opInfo{
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outputs: []outputInfo{
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},
},
},
......@@ -12817,7 +12817,7 @@ var opcodeTable = [...]opInfo{
{0, 2305843009347911678}, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 SP g SB
},
outputs: []outputInfo{
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{0, 576460752169205760}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31
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},
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reg: regInfo{
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},
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......@@ -13086,10 +13086,10 @@ var opcodeTable = [...]opInfo{
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......@@ -13099,10 +13099,10 @@ var opcodeTable = [...]opInfo{
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},
......@@ -13112,10 +13112,10 @@ var opcodeTable = [...]opInfo{
asm: mips.ATRUNCDW,
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......@@ -13125,10 +13125,10 @@ var opcodeTable = [...]opInfo{
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......@@ -13138,10 +13138,10 @@ var opcodeTable = [...]opInfo{
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......@@ -13151,10 +13151,10 @@ var opcodeTable = [...]opInfo{
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......@@ -13164,10 +13164,10 @@ var opcodeTable = [...]opInfo{
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},
},
{
......@@ -13190,7 +13190,7 @@ var opcodeTable = [...]opInfo{
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},
{
......@@ -13208,7 +13208,7 @@ var opcodeTable = [...]opInfo{
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{
......@@ -13220,7 +13220,7 @@ var opcodeTable = [...]opInfo{
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},
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},
},
{
......@@ -16584,7 +16584,7 @@ var registersARM64 = [...]Register{
{62, "SB"},
}
var gpRegMaskARM64 = regMask(133955583)
var fpRegMaskARM64 = regMask(288230375077969920)
var fpRegMaskARM64 = regMask(4611686017353646080)
var specialRegMaskARM64 = regMask(0)
var framepointerRegARM64 = int8(-1)
var registersMIPS64 = [...]Register{
......@@ -16652,7 +16652,7 @@ var registersMIPS64 = [...]Register{
{61, "SB"},
}
var gpRegMaskMIPS64 = regMask(33554430)
var fpRegMaskMIPS64 = regMask(385057768005959680)
var fpRegMaskMIPS64 = regMask(576460752169205760)
var specialRegMaskMIPS64 = regMask(1729382256910270464)
var framepointerRegMIPS64 = int8(-1)
var registersPPC64 = [...]Register{
......@@ -16714,6 +16714,11 @@ var registersPPC64 = [...]Register{
{55, "F24"},
{56, "F25"},
{57, "F26"},
{58, "F27"},
{59, "F28"},
{60, "F29"},
{61, "F30"},
{62, "F31"},
}
var gpRegMaskPPC64 = regMask(536866812)
var fpRegMaskPPC64 = regMask(288230371856744448)
......
src/cmd/internal/obj/arm64/a.out.go
View file @ f9dafc74
......@@ -229,14 +229,10 @@ const (
REGZERO = REG_R31
REGSP = REG_RSP
FREGRET = REG_F0
FREGMIN = REG_F7 // first register variable
FREGMAX = REG_F26 // last register variable for 7g only
FREGEXT = REG_F26 // first external register
FREGZERO = REG_F28 // both float and double
FREGHALF = REG_F29 // double
FREGONE = REG_F30 // double
FREGTWO = REG_F31 // double
FREGRET = REG_F0
FREGMIN = REG_F7 // first register variable
FREGMAX = REG_F26 // last register variable for 7g only
FREGEXT = REG_F26 // first external register
)
const (
......
src/cmd/internal/obj/mips/a.out.go
View file @ f9dafc74
......@@ -185,22 +185,18 @@ const (
REG_SPECIAL = REG_M0
REGZERO = REG_R0 /* set to zero */
REGSP = REG_R29
REGSB = REG_R28
REGLINK = REG_R31
REGRET = REG_R1
REGARG = -1 /* -1 disables passing the first argument in register */
REGRT1 = REG_R1 /* reserved for runtime, duffzero and duffcopy */
REGRT2 = REG_R2 /* reserved for runtime, duffcopy */
REGCTXT = REG_R22 /* context for closures */
REGG = REG_R30 /* G */
REGTMP = REG_R23 /* used by the linker */
FREGRET = REG_F0
FREGZERO = REG_F24 /* both float and double */
FREGHALF = REG_F26 /* double */
FREGONE = REG_F28 /* double */
FREGTWO = REG_F30 /* double */
REGZERO = REG_R0 /* set to zero */
REGSP = REG_R29
REGSB = REG_R28
REGLINK = REG_R31
REGRET = REG_R1
REGARG = -1 /* -1 disables passing the first argument in register */
REGRT1 = REG_R1 /* reserved for runtime, duffzero and duffcopy */
REGRT2 = REG_R2 /* reserved for runtime, duffcopy */
REGCTXT = REG_R22 /* context for closures */
REGG = REG_R30 /* G */
REGTMP = REG_R23 /* used by the linker */
FREGRET = REG_F0
)
const (
......
src/cmd/internal/obj/ppc64/a.out.go
View file @ f9dafc74
......@@ -132,29 +132,24 @@ const (
REG_LR = REG_SPR0 + 8
REG_CTR = REG_SPR0 + 9
REGZERO = REG_R0 /* set to zero */
REGSP = REG_R1
REGSB = REG_R2
REGRET = REG_R3
REGARG = -1 /* -1 disables passing the first argument in register */
REGRT1 = REG_R3 /* reserved for runtime, duffzero and duffcopy */
REGRT2 = REG_R4 /* reserved for runtime, duffcopy */
REGMIN = REG_R7 /* register variables allocated from here to REGMAX */
REGCTXT = REG_R11 /* context for closures */
REGTLS = REG_R13 /* C ABI TLS base pointer */
REGMAX = REG_R27
REGEXT = REG_R30 /* external registers allocated from here down */
REGG = REG_R30 /* G */
REGTMP = REG_R31 /* used by the linker */
FREGRET = REG_F0
FREGMIN = REG_F17 /* first register variable */
FREGMAX = REG_F26 /* last register variable for 9g only */
FREGEXT = REG_F26 /* first external register */
FREGCVI = REG_F27 /* floating conversion constant */
FREGZERO = REG_F28 /* both float and double */
FREGHALF = REG_F29 /* double */
FREGONE = REG_F30 /* double */
FREGTWO = REG_F31 /* double */
REGZERO = REG_R0 /* set to zero */
REGSP = REG_R1
REGSB = REG_R2
REGRET = REG_R3
REGARG = -1 /* -1 disables passing the first argument in register */
REGRT1 = REG_R3 /* reserved for runtime, duffzero and duffcopy */
REGRT2 = REG_R4 /* reserved for runtime, duffcopy */
REGMIN = REG_R7 /* register variables allocated from here to REGMAX */
REGCTXT = REG_R11 /* context for closures */
REGTLS = REG_R13 /* C ABI TLS base pointer */
REGMAX = REG_R27
REGEXT = REG_R30 /* external registers allocated from here down */
REGG = REG_R30 /* G */
REGTMP = REG_R31 /* used by the linker */
FREGRET = REG_F0
FREGMIN = REG_F17 /* first register variable */
FREGMAX = REG_F26 /* last register variable for 9g only */
FREGEXT = REG_F26 /* first external register */
)
/*
......
src/runtime/asm_arm64.s
View file @ f9dafc74
......@@ -11,9 +11,6 @@
TEXT runtime·rt0_go(SB),NOSPLIT,$0
// SP = stack; R0 = argc; R1 = argv
// initialize essential registers
BL runtime·reginit(SB)
SUB $32, RSP
MOVW R0, 8(RSP) // argc
MOVD R1, 16(RSP) // argv
......@@ -100,15 +97,6 @@ TEXT runtime·breakpoint(SB),NOSPLIT,$-8-0
TEXT runtime·asminit(SB),NOSPLIT,$-8-0
RET
TEXT runtime·reginit(SB),NOSPLIT,$-8-0
// initialize essential FP registers
FMOVD $4503601774854144.0, F27
FMOVD $0.5, F29
FSUBD F29, F29, F28
FADDD F29, F29, F30
FADDD F30, F30, F31
RET
/*
* go-routine
*/
......
src/runtime/asm_mips64x.s
View file @ f9dafc74
......@@ -14,9 +14,6 @@
TEXT runtime·rt0_go(SB),NOSPLIT,$0
// R29 = stack; R4 = argc; R5 = argv
// initialize essential registers
JAL runtime·reginit(SB)
ADDV $-24, R29
MOVW R4, 8(R29) // argc
MOVV R5, 16(R29) // argv
......@@ -88,19 +85,6 @@ TEXT runtime·breakpoint(SB),NOSPLIT,$-8-0
TEXT runtime·asminit(SB),NOSPLIT,$-8-0
RET
TEXT _cgo_reginit(SB),NOSPLIT,$-8-0
// crosscall1 needs to reginit, but can't
// get at the 'runtime.reginit' symbol.
JMP runtime·reginit(SB)
TEXT runtime·reginit(SB),NOSPLIT,$-8-0
// initialize essential FP registers
MOVD $0.5, F26
SUBD F26, F26, F24
ADDD F26, F26, F28
ADDD F28, F28, F30
RET
/*
* go-routine
*/
......
src/runtime/asm_ppc64x.s
View file @ f9dafc74
......@@ -106,12 +106,6 @@ TEXT _cgo_reginit(SB),NOSPLIT|NOFRAME,$0-0
TEXT runtime·reginit(SB),NOSPLIT|NOFRAME,$0-0
// set R0 to zero, it's expected by the toolchain
XOR R0, R0
// initialize essential FP registers
FMOVD $4503601774854144.0, F27
FMOVD $0.5, F29
FSUB F29, F29, F28
FADD F29, F29, F30
FADD F30, F30, F31
RET
/*
......
src/runtime/cgo/asm_arm64.s
View file @ f9dafc74
......@@ -43,7 +43,6 @@ TEXT crosscall2(SB),NOSPLIT,$-8
MOVD R0, R19
// Initialize Go ABI environment
BL runtime·reginit(SB)
BL runtime·load_g(SB)
BL (R19)
......
src/runtime/cgo/asm_mips64x.s
View file @ f9dafc74
......@@ -46,7 +46,6 @@ TEXT crosscall2(SB),NOSPLIT,$-8
BGEZAL R0, 1(PC)
SRLV $32, R31, RSB
SLLV $32, RSB
JAL runtime·reginit(SB)
JAL runtime·load_g(SB)
JAL (R4)
......
src/runtime/cgo/gcc_mips64x.S
View file @ f9dafc74
......@@ -35,8 +35,6 @@ crosscall1:
sdc1 $f30, 136($29)
sdc1 $f31, 144($29)
dla $23,_cgo_reginit
// prepare SB register = pc & 0xffffffff00000000
bal 1f
1:
......@@ -44,7 +42,6 @@ crosscall1:
dsll $28, $28, 32
move $20, $4 // save R4
jalr $23 // call _cgo_reginit, set up Go ABI constant registers
move $1, $6
jalr $5 // call setg_gcc (clobbers R4)
jalr $20 // call fn
......
src/runtime/cgo_mips64x.go deleted 100644 → 0
View file @ b2e0e968
// Copyright 2016 The Go Authors. All rights reserved.
// Use of this source code is governed by a BSD-style
// license that can be found in the LICENSE file.
// +build mips64 mips64le
package runtime
// crosscall1 calls into the runtime to set up the registers the
// Go runtime expects and so the symbol it calls needs to be exported
// for external linking to work.
//go:cgo_export_static _cgo_reginit
src/runtime/sys_linux_mips64x.s
View file @ f9dafc74
......@@ -238,9 +238,6 @@ TEXT runtime·sigtramp(SB),NOSPLIT,$64
SRLV $32, R31, RSB
SLLV $32, RSB
// initialize essential registers (just in case)
JAL runtime·reginit(SB)
// this might be called in external code context,
// where g is not set.
MOVB runtime·iscgo(SB), R1
......@@ -328,8 +325,6 @@ TEXT runtime·clone(SB),NOSPLIT,$-8
RET
// In child, on new stack.
// initialize essential registers
JAL runtime·reginit(SB)
MOVV -32(R29), R16
MOVV $1234, R1
BEQ R16, R1, 2(PC)
......
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